D-триггеры

D-триггер (от англ. delay) запоминает входную информа-цию при поступлении синхроимпульса. Рассуждая чисто теоре-тически, D-триггер можно образовать из любых RS- или JK-триггеров, если на их входы одновременно подавать взаимно инверсные сигналы.

JK-триггеры

JK-триггер (от англ. jump и keep), отличается от рассмот-ренного RS-триггера тем, что появление на обоих информацион-ных входах (J и K) логических единиц (для прямых входов) при-водит к изменению состояния триггера. Такая комбинация сигналов для JK-триггера не является запрещенной. В остальном JK-триггер подобен RS-триггеру, причем роль входа S играет вход J, а роль входа R – вход К.

RS-триггеры

Триггером называют логическую схему с положительной обратной связью, имеющую два устойчивых состояния – единичное и нулевое, которые обозначаются соответственно 1 и 0 (рис.23.1, а). В основе любого триггера находится кольцо из двух инверторов (рис. 23.1, б, в). Триггер является элементом памяти последовательностных логических устройств, на схемах он обозначается буквой Т

Перемножающие устройства на основе сумматоров

На рис. 22.11 показана схема для перемножения двух дво-ичных чисел: четырехразрядного A = A4A3A2A1 и трехразрядного B = B3B2B1. Семиразрядное произведение формируется за счет парал-лельного умножения множимого на каждый разряд множителя логическими элементами 2И и сложения промежуточных произ-ведений со сдвигом на один разряд - сумматором.

Сравнение двоичных чисел

Сравнение многоразрядных чисел основывается на проверке равенства цифр чисел. Пусть даны два числа А3А2А1А0 и В3В2В1В0 . Сравниваются В3 и А3 , В2 и А2 , В1 и А1 , В0 и А0 , по результатам сравнения делается вывод: если совпали и третьи цифры, и вторые, и первые, и нулевые, то числа одинаковы. Таблица истинности поразрядного сравнения изображена на рис. 22.7.

Вычитание двоичных чисел

С помощью одних и тех же сумматоров можно не только складывать, но и вычитать двоичные числа. Микросхема К555ИМ7 (рис. 22.5, в) позволяет суммировать или вычитать одновременно четыре пары двоичных чисел, поступающих в последовательном коде на входы A и B. Режим работы – суммирование или вычитание задается установкой на входах V соответствующего логического уровня.

Сумматоры Суммирование двоичных чисел

Сумматором называется комбинационное цифровое уст-ройство, предназначенное для выполнения операции арифмети-ческого сложения чисел, представленных в виде двоичных кодов. Сумматоры используются в операциях суммирования и вычитания чисел, а также составляют основу умножения и деления чисел. По принципу обработки разрядов чисел различают после-довательные и параллельные сумматоры.